五道工序讲完一层电路
涂胶、曝光、显影、刻蚀、镀铜抛光,一步一个模块;左边是设备,右边是同一块晶圆的剖面,看得到每一步留下了什么。
芯片工艺要讲给投资人、客户和新员工听,难在尺度太小:几十纳米的线条、看不见的光和等离子体,剖面图又太抽象。下面这个实验室用代码画了一层芯片电路的五道工序:涂胶、曝光、显影、刻蚀、镀铜,左边是设备,右边是按纳米比例画的晶圆剖面。
空间像、胶线宽、沟槽深度和导线电阻都按光刻和刻蚀的常用模型现算。把光源从 EUV 换成 DUV、拖小数值孔径或改剂量,就能看到 36 nm 的线条为什么只有 EUV 能一次印出来。您的工艺、设备或材料,也可以照这个方式做成视频、动图或网页演示。
EUV 13.5 nm · NA 0.33 · 周期 36 nm · 胶厚 35 nm · 铜互连
2000 转每分钟,20 µm 的液膜第一秒就被甩到 5 µm 左右;之后主要靠溶剂挥发,二十秒左右定型。EUV 用的胶只有 35 nm 厚,DUV 用 90 nm。
周期越小,衍射光越难进镜头,投下来的像就越糊。R = k1·λ/NA:波长从 193 nm 换成 13.5 nm,36 nm 周期从一片模糊变成清楚的明暗条纹。
剂量大,曝光区变宽,胶线变细;剂量小,间隔显不开。线宽落在目标 ±10% 以内的那段剂量,就是这道工序的工艺窗口。电镜图上线边的毛刺,来自光子数的随机起伏。
晶圆下面加了偏压,离子几乎垂直地往下打,所以沟槽侧壁是直的。胶也在被慢慢消耗,选择比 4:1;沟槽越窄刻得越慢,最后几秒过刻就是给窄沟槽补到底的。
线宽缩到二十纳米上下,电子在表面和晶界上来回散射,铜的电阻率翻倍;阻挡层又占掉一圈截面,所以电阻涨得比截面缩得还快。这也是先进工艺开始试用钌、钼等新金属的原因。
涂胶、曝光、显影、刻蚀、镀铜抛光,一步一个模块;左边是设备,右边是同一块晶圆的剖面,看得到每一步留下了什么。
剖面横竖按同一纳米比例尺画;空间像、胶线宽、沟槽深度、导线电阻都按光刻和刻蚀的常用模型现算,曲线和画面用同一组数。
换光源、拖数值孔径、改剂量和周期,就能看到线条什么时候印得出、什么时候粘连或变细,适合讲设备和材料的价值。
同一个实验室可以录成 4K 工艺视频、拆成分步动图,也可以直接放进官网、展会屏幕和融资路演。
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本页内容更新于 2026-10-24
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